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画像 19. に C9500-48Y4C スイッチ コンポーネントのハイレベル概要を提供します。
 
画像 19. に C9500-48Y4C スイッチ コンポーネントのハイレベル概要を提供します。
 
[[ファイル:C95 arc-19.png|なし|フレーム|画像 19. C9500-48Y4C ハイレベル ブロック ダイアグラム]]
 
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==== C9500-48Y4C スイッチのハイライトは以下の通りです : ====
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* 2x1 コンフィギュレーションモードの 12 列の SFP28 ケージと、2x1 コンフィギュレーションモードの 2 列の QSFP28 ケージ
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* それぞれの SFP28 ケージは、ASIC に向かう 24 つのノースバウンド SERDES 接続を持ちます
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** それぞれの SERDES は次のどちらかで動作します  SFP28 オプティクスによる 25G スピード  もしくは SFP+ オプティクスで 10G スピード
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** インターフェーススピードは、挿入されたトランシーバ モジュール ベース
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* それぞれの QSFP28 ケージは、ASIC に向かう 8 つのノースバウンド SERDES を持ちます
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** それぞれの SERDES 接続は 40G QSFP+ オプティクスで 4x10G スピード  もしくは 100G QSFP28 オプティクスで 4x25G スピード
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* ポートマッピング
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** ポート 1-24 と 49-50 は ASIC 0 / コア 1 にマッピング
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** ポート 25-48 と 51-52 は ASIC 0 / コア 0 にマッピング
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* オプティクスの電源はオンボードコントローラによって行われ、フロント パネル ケージに挿入されたモジュールで使用されます
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* アドバンスド フォワーディング ASIC は、100Gbps シングル フロー トラフィック処理をアップリンク ポートでサポートし、25G シングル フロー トラフィック処理をダウンリンク ポートでサポートします
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Note : C9500-24Y4C スイッチは 1xUADP 3.0 ASIC を備え、C9500-48Y4C と全く同じアーキテクチャになっています  類似のポートマッピングを持ち、全体では 24 x 25G/10G/1G ポートと 4 x QSFP28 イーサネット アップリンク ポートを備えています

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